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NVIDIA将Vera CPU导入芯片设计流程，提速下一代芯片研发

NVIDIA宣布，已将自研Vera CPU引入下一代芯片设计流程，并与Cadence、Synopsys联合优化关键EDA应用。测试显示，在Cadence Jasper和Synopsys VCS上，Vera CPU在相同核心数条件下可使部分工作负载性能最高提升1.5倍，有助于提升逻辑仿真和验证环节效率，缩短研发周期。

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Yuanjiwei发布2D半导体8英寸试产线规划：2029年前瞄准不依赖EUV设备实现5nm级性能

总部位于上海的半导体初创企业Yuanjiwei日前发布2D半导体8英寸试产线规划，称该产线覆盖2D材料制备、芯片集成到流片全流程，并提出到2029年实现不依赖EUV设备、性能达到5nm级的全国产工艺路线。